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Verilog语法整理
发表于2025-07-10|FPGA
一、Verilog数据类型1.1 wire类型wire类型用于表示硬件电路单元之间的物理连线。 未声明的信号类型默认为wire 1234567比如下面的这种情况,默认定义为wire型module key( input clk_i, //默认wire input key_i, //默认wire output key_cap //默认wire,不允许在always块中赋值);endmodule wire不允许在always块内部定义和赋值,但可以在always块使用非阻塞赋值<=取其数值 常用在always块外部用assign连续赋值(硬件相连) eg: 1234567891011121314151617181920212223module d_flip_flop( //以D触发器为例,输出信号有reg,也有wire,以说明其赋值操作的区别 input wire clk, input wire rst_n, input wire D, //wire型输入 output reg Q_reg, //reg型输出 ...
Zotero使用攻略
发表于2024-04-16|科研
Zotero是什么Zotero是针对科研人员的一款文献管理软件 为什么要用Zotero使用Zotero和多种多样的插件,可以实现99%中英文文献的保存、分类、查找、引用。 快速的保存中英文论文 在几百篇文献中快速定位自己想要的论文 写小论文与大论文时快速插入参考文献,对于中英文参考文献格式有几乎全覆盖的格式库,并且只需要改Zotero词条就可以做到修改参考文献引用内容 对论文的分类、IF排序、写简记、JCR分类 Zotero应用效果展示 保存文献(中文:知网/万方等 + 英文:google学术/webofscience/scihub等)1.1 保存中文文献: 1.2 保存英文文献: 快速筛选论文: 写小论文与大论文时快速插入参考文献3.1 word环境下引用+插入参考文献: 3.2 latex环境下引用+插入参考文献: Zotero使用教程软件安装插件推荐与安装插入参考文献word环境latex环境
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